Die JEDEC Solid State Technology Association hat die endg\u00fcltigen Spezifikationen f\u00fcr den neuen Standard LPDDR6 ver\u00f6ffentlicht, einen Meilenstein im Fortschritt des Low Power Double Data Rate (LPDDR) Speichers. Dieser Speicherstandard spielt eine zentrale Rolle bei der Performance-Steigerung von Ger\u00e4ten wie Notebooks, Smartphones und Tablets, insbesondere im Zusammenspiel mit leistungsstarken System-on-Chip (SoC). \u00c4hnlich wie sein Vorg\u00e4nger LPDDR5 nutzt auch LPDDR6 zwei Sub-Kan\u00e4le, um eine maximale Bandbreite zu erzielen. Pro Kanal besitzt der Datenbus weiterhin eine Breite von 12 Bit, was f\u00fcr eine effiziente Daten\u00fcbertragung sorgt. Ein bemerkenswerter Wechsel betrifft jedoch den CA-Bus (Command\/Address-Bus). Seit LPDDR4 war dieser 6 Bit breit und steuert als Steuerzentrum die Kommunikation zwischen Controller und Speicherzellen \u2013 er bestimmt die Ausf\u00fchrung von Operationen, ihre Location und den Zeitpunkt. Mit LPDDR6 wird der CA-Bus auf 4 Bit reduziert, was auf Optimierungen im Steuerungsprozess hindeutet. LPDDR6 verspricht eine signifikante Steigerung der Datenraten im Vergleich zu seinem Vorg\u00e4nger. W\u00e4hrend LPDDR5X aktuell bei bis zu 10.700 MT\/s (MegaTransfers pro Sekunde) liegt, soll LPDDR6 Daten\u00fcbertragungen von 8.800 bis sogar 17.600 MT\/s erm\u00f6glichen. Diese Leistungsverbesserung wird ma\u00dfgeblich zu einer noch schnelleren Verarbeitung und einer verbesserten Benutzererfahrung in den genannten Ger\u00e4ten beitragen. Die gro\u00dfen Speicherhersteller Micron, Samsung und SK Hynix haben angek\u00fcndigt, LPDDR6-Module anbieten zu k\u00f6nnen, sobald der Standard vollumf\u00e4nglich implementiert ist. Allerdings gibt es bisher keine konkreten Zeitrahmen f\u00fcr den Markteintritt dieser neuen Speichermodule.<\/p>\n
Schlagw\u00f6rter: LPDDR6 + LPDDR + SoC<\/p>\n","protected":false},"excerpt":{"rendered":"
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