AMD plant, seine wichtigsten Modellreihen im n\u00e4chsten Jahr auf Zen-5-Kerne umzustellen, obwohl die ersten Ryzen-8000-Prozessoren f\u00fcr das Modelljahr 2024 noch auf Zen-4-Kerne basieren. Bereits seit einigen Monaten sind die EPYC-Prozessoren mit Zen-5-Kernen als fr\u00fche Samples im Einsatz, und nun sind weitere Fotos und Informationen aufgetaucht.<\/p>\n
Die kommenden Modelle Turin (Zen 5) und Breithorn (Zen 5) werden als Nachfolger von Genoa (Zen 4) und Bergamo (Zen 4c) problemlos in den aktuellen SP5-Sockel passen, ohne dass Ver\u00e4nderungen an der Anzahl der Speicherkan\u00e4le (zw\u00f6lf) und PCI-Express-Lanes (128) erwartet werden.<\/p>\n
Die Standard-EPYC-Modelle Turin werden bis zu 128 Kerne in 16 CCDs unterst\u00fctzen k\u00f6nnen. Bisher verf\u00fcgten die 9004-Modelle \u00fcber maximal 96 Kerne in zw\u00f6lf CCDs. Nun werden vier zus\u00e4tzliche CCDs hinzugef\u00fcgt. Mit der Einf\u00fchrung der Zen-5c-Kerne wird AMD die Anzahl der Kerne pro CCD auf 16 erh\u00f6hen und insgesamt 192 Kerne bei zw\u00f6lf CCDs anbieten – im Vergleich zu den derzeitigen 128 Kernen in der 97×4-Serie. Die Verbindung der 16 und zw\u00f6lf CCDs erfolgt \u00fcber einen zentralen IOD, wobei AMDs Infinity Fabric verwendet wird.<\/p>\n
Die Anzahl der Speicherkan\u00e4le bleibt unver\u00e4ndert bei zw\u00f6lf, jedoch werden Turin und Breithorn DDR5-6000 unterst\u00fctzen. Es ist unklar, welche Fertigungstechnologie AMD f\u00fcr die CCDs und den IOD verwendet. In den AMD-Roadmaps wurde f\u00fcr Zen 5 immer von einem fortschrittlichen Knoten und sp\u00e4ter von 4 bzw. 3 nm gesprochen. Es ist am wahrscheinlichsten, dass die CCDs auf 4 nm und der IOD auf 6 nm gefertigt werden, da TSMC voraussichtlich erst 2024 seinen 3-nm-Prozess f\u00fcr diese Art von HPC-Chips bereitstellen wird.<\/p>\n
AMD erwartet f\u00fcr Zen 5 eine Steigerung der IPC um 10 bis 15 %, unter anderem durch eine Erweiterung des L1-Data-Caches von 32 kB auf 48 kB, der bei Zen 4 noch vorhanden ist. Dar\u00fcber hinaus ist geplant, sechs ALUs (Arithmetic Logic Units) zu verwenden, im Vergleich zu den vier ALUs bei Zen 4. Zus\u00e4tzlich soll das Datenformat FP512 unterst\u00fctzt werden. AMD implementiert in Zen 4 AVX-512-Befehlss\u00e4tze, die eine doppelte Ausf\u00fchrung von FP256 erm\u00f6glichen.<\/p>\n
Der genaue Ver\u00f6ffentlichungstermin der EPYC-Prozessoren mit Zen-5-Kernen ist bisher unbekannt. Es ist unklar, wann AMD seine neuen Ryzen-Modelle pr\u00e4sentieren wird. Es wird jedoch nicht vor dem zweiten Halbjahr 2024 erwartet und m\u00f6glicherweise k\u00f6nnte eine Enth\u00fcllung zur Computex Anfang Juni stattfinden.<\/p>\n
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