{"id":7083,"date":"2024-04-25T12:59:18","date_gmt":"2024-04-25T12:59:18","guid":{"rendered":"https:\/\/byte-bucket.com\/2024\/04\/25\/leak-zeigt-details-zu-amd-apus-strix-point-strix-halo-mit-zen-5-kernen-rdna-3-5-grafik\/"},"modified":"2024-04-25T12:59:18","modified_gmt":"2024-04-25T12:59:18","slug":"leak-zeigt-details-zu-amd-apus-strix-point-strix-halo-mit-zen-5-kernen-rdna-3-5-grafik","status":"publish","type":"post","link":"https:\/\/byte-bucket.com\/?p=7083","title":{"rendered":"Leak zeigt Details zu AMD-APUs: Strix Point &#038; Strix Halo mit Zen-5-Kernen &#038; RDNA 3.5 Grafik"},"content":{"rendered":"<p>Ein k\u00fcrzlich aufgetauchter Leak deutet darauf hin, dass die chinesischen Mitarbeiter von HKEPC Zugriff auf ein 114-seitiges Dokument mit technischen Details zu den kommenden APUs Strix Point und Strix Halo von AMD hatten. Diese Informationen geben einen Einblick in die beeindruckenden Spezifikationen der neuen Prozessoren.<\/p>\n<p>Laut dem Dokument wird Strix Point voraussichtlich mit zw\u00f6lf Zen-5-Kernen ausgestattet sein. Jeder Kern verf\u00fcgt \u00fcber 1 MB L2-Cache, was insgesamt 12 MB L2-Cache entspricht. Der L3-Cache wird mit 24 MB angegeben, was bedeutet, dass Strix Point im Vergleich zu den aktuellen Desktop-Prozessoren weiterhin die H\u00e4lfte des L3-Caches beh\u00e4lt. Die integrierte Grafikeinheit wird mit acht WGP (Workinggroup-Agents) ausgestattet sein, was insgesamt 16 Compute Units entspricht. Diese Grafikeinheit basiert auf der RDNA 3.5 Architektur. Ein weiteres bemerkenswertes Merkmal ist der integrierte AI-Beschleuniger, der auf der XDNA-2-Architektur basiert und eine Rechenleistung von 50 TOPS bietet, was etwa der dreifachen Leistung der NPU der aktuellen Generation entspricht. Die TDP-Bandbreite von Strix Point liegt zwischen 45 und 65 W, und als Arbeitsspeicheroption kann LPDDR5X-7500 genutzt werden.<\/p>\n<p>Strix Halo ist eine gr\u00f6\u00dfere APU, die ebenfalls in den Ger\u00fcchten auftaucht. Laut dem Dokument wird sie ganze 16 Zen-5-Kerne verwenden. Der L2-Cache wird auf 16 MB erh\u00f6ht und der L3-Cache auf 32 MB. Auch hier beh\u00e4lt jeder Kern die H\u00e4lfte des L3-Caches, der den leistungsstarken Desktop-Prozessoren zur Verf\u00fcgung steht. Die integrierte Grafikeinheit basiert auch auf der RDNA-3.5-Architektur und ist mit 40 CUs oder 20 WGPGs ausgestattet, was bisher nur von den individuellen Chips f\u00fcr Konsolen bekannt war. Es wird angenommen, dass Strix Halo auch einen Last Level Cache (MALL) mit einer Gr\u00f6\u00dfe von 32 MB verwendet. Die NPU in Strix Halo wird voraussichtlich eine Geschwindigkeit von 60 TOPS erreichen, was eine Steigerung von 20 % gegen\u00fcber Strix Point bedeutet. Zus\u00e4tzlich unterst\u00fctzt Strix Halo LPDDR5X-8000 mit einem 256-Bit breiten Speicherinterface. Die Standard-TDP wird mit 70 W angegeben, wobei eine maximale TDP von bis zu 130 W m\u00f6glich sein soll.<\/p>\n<p>Beide Prozessoren bieten 16 PCI-Express-4.0-Lanes, eine Vielzahl von USB-Anschl\u00fcssen und unterst\u00fctzen die DisplayPort 2.1 UHBR10\/20 f\u00fcr die Ausgabe auf einem Bildschirm. Es wird erwartet, dass AMD weitere Informationen zu den Zen-5-Prozessoren w\u00e4hrend der Computex bekannt geben wird. Es bleibt jedoch unklar, ob es sich dabei nur um einen Ausblick handelt oder ob bereits vollst\u00e4ndige Produktserien pr\u00e4sentiert werden.<\/p>\n<p>Schlagw\u00f6rter: Strix Point + Strix Halo + AMD MALL<\/p>\n","protected":false},"excerpt":{"rendered":"<p>Ein k\u00fcrzlich aufgetauchter Leak deutet darauf hin, dass die chinesischen Mitarbeiter von HKEPC Zugriff auf ein 114-seitiges Dokument mit technischen Details zu den kommenden APUs Strix Point und Strix Halo von AMD hatten. Diese Informationen geben einen Einblick in die beeindruckenden Spezifikationen der neuen Prozessoren. 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